数字验证工程师 30-60k·16薪
杭州-滨江区 3-5年 硕士
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刘女士 5小时前在线 已认证
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职位介绍
职责描述: 1)能够建立system Verilog或UVM验证环境平台并能够进行模块和系统级验证,根据需要集成第三方验证IP和C model 2)经过验证的ASIC / FPGA验证能力和测试平台开发经验 3)了解System Verilog(SV)和面向对象的编程概念 4)使用UVM / OVM方法开发模块级和子系统级测试台的经验 任职要求: 1)硕士及以上学历,微电子、电子工程类、通信类等相关专业; 2)2~5年数字验证经验 3)熟练使用C /C++/matlab语言 4)对UVM/VMM、System Verilog 熟练使用 5)熟悉SOC 设计一般架构 6)熟练使用python或其他脚本需要 7)熟悉数模混合电路的验证流程

公司简介

First 56GS/s Serdes and 32GS/s ADC IP provider in China! 我司创立于2016年6月,注册资金2000万。公司总部位于张江高科技园区,是海归团队创办的基于中国本土的高端IC(集成电路)设计公司。 公司专注模拟和混合信号IP和芯片研发和产业化,SerDes,ADC和PLL是公司核心技术和产品,已成功研发出16nm 56G PAM4 SerDes,32G 7b ADC,和28G低抖动PLL芯片,并通过了权威机构/公司的测试,性能达到国际先进水平,填补了国内空白。 钫铖坚持员工与公司一起成长,努力为广大员工搭建以能力为基石的发展平台!
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