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IC Design Engineer、architect-Chiplet/CXL/UCIe/Ethernet/NoC/d2d/cache 80-100k·16薪

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职位介绍: IC Design Engineer、architect-Chiplet/CXL/UCIe/Ethernet/NoC/d2d/cache/ddr/HBM 地址：北京朝阳区/上海长泰广场/西安雁塔区 Responsibilities 1. Develop micro-architecture, write micro-architecture spec and other documents 2. Write RTL code, meet the function target and have good performance/power/area efficiency 3. Apply low power, DFT, DFD and other digital design techniques 4. Work with DV team to improve test plan and debug failed tests 5. Clean Lint, timing and other issues 6. Participate in silicon debugging Qualifications 1. Master in electrics or computer engineering 2. At least 5 years working experience in ASIC logic design 3. Expertise in one or more of the following areas: 1)Experience in Chiplet chip development and mass production 2)In-depth knowledge of D2D/C2C protocols such as CXL, UCIe 3)Familiarity with Ethernet 4)Familiarity with NoC 5)Familiarity with Cache coherence 6)Familiarity with DDR/HBM 4. Familiar with front-end EDA tools and flows

其他信息: 语言要求：普通话; 行业要求：智能硬件

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f. 工作时长违反劳动法规定；
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